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更新:2018-08-13
  • 15K-20K
  • 职位福利
  • 本科 / 经验2年以上 / 性别男 / 23~39岁
  • 东莞市(广东省东莞市塘厦镇鹿苑路160号B栋4楼)
  • 招聘1人
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  • 2018-08-17

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职位描述 面试评价(0) 公司简介
1.熟悉Xilinx/Altera FPGA的开发,及其资源于Verilog行为描述方法的关系;
2.熟练掌握Synplify , Quartus,ISE, Modelsim ;
3.具有比較扎實的數字電路知識;
4.组合电路,触发器,特别是D触发器构成分频器,奇数倍分频占空比为50%,时序电路,并且能用Verilog语言描叙;
5.熟悉FPGA设计流程(仿真,综合,布局布线,时序分析),能夠獨立進行FPGA需求分析,芯片評估,器件選型並完成FPGA系統設計、代碼設計、仿真和調試工作;
6.熟练掌握资源估算(特别是slice, lut , ram等资源的估算);
7.熟练掌握,如建立时间,保持时间,流量(即所做FPGA设计的波特率)计算,延迟时间计算(所做FPGA设计),竞争冒险,消除毛刺的方法等等;
8.英語水平良好,能熟練閱讀英文技術資料;
9.工作積極主動,學習和適應能力強,善於溝通,能承受壓力,具有團隊精神。
PCB设备制造 外商独资.外企办事处 50~200人 深圳市
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